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DK Design Suite and PDK v5.0.SP5 英文正式版(基於ANSI-C的Handel-C語言為基礎軟體)

安裝序號:
序號產生器放至於keygen夾內
內容說明:
Celoxica DK design suite提供以基於ANSI-C的Handel-C語言為基礎的高階設計方法，可在硬體
中快速設計和實現複雜的運算法，除了先進的合成及時序評估工具外，DK的區域和延遲分析也可
為快速最佳化提供佈局前的早期時序和區域評估。該設計工具除了能輸出特定FPGA平台EDIF格式
外(包含 Xilinx,Altera,Actel大部分的晶片)，它能輸出結構化的Verilog和VHDL，
並保留Handel-C原始碼的層次性，因此用戶能利用傳統的仿真工具來除錯Verilog或VHDL輸出。
HDL輸出能用於FPGA/可程式平台，也可用於ASIC工具流程。Celoxica DK將C語言設計到FPGA的流
程和方法最佳化，可讓軟體工程師、硬體設計者及系統架構設計師維持高性能的FPGA方案，並同
時加速高可靠性、高速通訊的設計，以及從概念到實現的ASIC替代方案。
英文說明:
The DK Design Suite dramatically simplifies
the path from signal processing algorithm
in C to FPGA implementation. DK's C-based
synthesis technology, platform abstraction
layers (PAL) and pre-built libraries make
it a breeze to map an algorithmic C onto an
FPGA. When combined with the Agility RC
platform, users now have a complete
algorithm prototyping solution. DK's
development environment also provides the
capability to explore and optimize
implementations to meet real-time
requirements.
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